Ewolucyjna minimalizacja poboru mocy podczas procesu testowania kombinacyjnych układów cyfrowych - Publikacja - MOST Wiedzy

Wyszukiwarka

Ewolucyjna minimalizacja poboru mocy podczas procesu testowania kombinacyjnych układów cyfrowych

Abstrakt

W artykule przedstawiono zastosowanie algorytmu ewolucyjnego do minimalizacji poboru mocy podczas procesu testowania kombinacyjnych układów cyfrowych. Przy użyciu proponowanej metody dokonano wyboru kolejności podawania na wejścia układu wektorów testowych, aby liczba przełączeń bramek wchodzących w jego skład była jak najmniejsza. Pod uwagę wzięto cztery układy wybrane z literatury. Otrzymane wyniki wskazują, że możliwe jest użycie algorytmu ewolucyjnego do zmniejszenia liczby przełączeń bramek testowanego układu, a tym samym do zmniejszenia mocy pobieranej przez niego podczas procesu testowania.

Cytuj jako

Pełna treść

pełna treść publikacji nie jest dostępna w portalu

Słowa kluczowe

Informacje szczegółowe

Kategoria:
Aktywność konferencyjna
Typ:
publikacja w wydawnictwie zbiorowym recenzowanym (także w materiałach konferencyjnych)
Tytuł wydania:
V Krajowa Konferencja Elektroniki : materiały konferencyjne, Darłówko Wschodnie, 12-14 czerwca 2006, T. 1/2 strony 167 - 172
Język:
polski
Rok wydania:
2006
Opis bibliograficzny:
Słowik A., Białko M.: Ewolucyjna minimalizacja poboru mocy podczas procesu testowania kombinacyjnych układów cyfrowych// V Krajowa Konferencja Elektroniki : materiały konferencyjne, Darłówko Wschodnie, 12-14 czerwca 2006, T. 1/2/ ed. red. W. Janke, M. Bączek, S. Łuczak. Koszalin: Politech. Koszal., 2006, s.167-172
Weryfikacja:
Politechnika Gdańska

wyświetlono 10 razy

Publikacje, które mogą cię zainteresować

Meta Tagi