dr hab. inż. Grzegorz Blakiewicz
Employment
- Associate professor at Department of Microelectronic Systems
Publications
Filters
total: 47
Catalog Publications
Year 2002
-
Zastosowanie rekurencyjnych algorytmów splotowych do symulacji układów impulsowego przetwarzania mocy
PublicationW pracy omówiono problemy związane z symulacją w dziedzinie czasu układów impulsowego przetwarzania mocy. Zaproponowano nową metodę opartą na rekurencyjnych półanaitycznych algorytmach splotowych. Przedstawiono właściwości tych algorytmów oraz przykłady symulacji prostych układów mocy. Algorytmy splotowe charakteryzują się bezwzględną stabilnością, dużą dokładnością oraz małą złożonością numeryczną. Z tych powodów proponowana metoda...
Year 2004
-
Substrate noise-aware floorplanning for mixed-signal SOCs.
PublicationOpisano nową metodę projektowania systemów na chipie z uwzglednieniem minimalizacji szumu podłożowego. Optymalizacje rozmieszczenia bloków układowych na chipie uzyskuje się dzieki wykorzystaniu algorytmu ewolucyjnego minimalizującego funkcję celu uwzględniającą poziom szumu podłożowego.
Year 2005
-
Modeling of substrate noise block properties for early rediction.
PublicationZaproponowano nowe podejscie do modelowania zakłóceń podłozowych we wczesnym etapie projektowania systemów na wspólnym podłożu krzemowym. Modelowanie zakłóceń oparto na założeniu, że głównym źródłem zakłóceń podłożowych jest sieć zasilająca. W oparciu o przeprowadzone symulacjie wykazano słusznosć takiej metody.
-
Substrate noise modeling in early floorplanning of MS-SOCs.
PublicationW pracy zaproponowano model częstotliwościowy bloków analogowych wrażliwych na zakłócenia oraz bloków cyfrowych generujących zakłócenia w systemach mieszanych realizowanych na wspólnym podłożu krzemowym. Zaproponowane modele zostały wykorzystane w oprogramowaniu optymalizującym rozmieszczenie bloków funkcjonalnych na struktórze krzemowej. Dzieki użyciu procedur optymalizacyjnych uzyskano znaczącą redukcje poziomu zakłóceń przy...
Year 2006
-
Noise modeling of static CMOS gates for low-noise circuit synthesis
PublicationW artykule przedstawiono efektywną metodę modelowania widma szumu napięcia zasilającego generowanego przez statyczne bramki cyfrowe CMOS. Metoda modelowania uwzględnia krótkie impulsy prądowe powstające w czasie przełączania bramek i pozwala oszacować górne limity widma szumu napięcia zasilającego co umożliwia niskoszumową syntezę układów cyfrowych.
-
Zastosowanie algorytmów splotowych w syntezie cyfrowych sterowników przetwornic impulsowych
PublicationW pracy przedstawiono koncepcję zastosowania rekursywnych algorytmów splotowych do dyskretyzacji transmitancji małosygnałowych przetwornic impulsowych jako efektywną metodę syntezy korektorów wchodzących w skłąd sterowników cyfrowych. Użycie proponowanych metod dyskretyzacji zapewnia zachowanie stabilności wzorców analogowych jak również umożliwia osiągnięcie wysokiej dokładności aproksymacji, która może być dowolnie podwyższana...
Year 2007
-
Porównanie właściwości układów tłumienia zakłóceń podłożowych
PublicationOmówiono wybrane metody redukcji zakłóceń w systemach mikroelektronicznych ze szczególnym uwzględnieniem układów aktywnych. Zaproponowano wtórnik przeciwsobny do tłumienia zakłóceń podłożowych, dzięki czemu uzyskano lepsze tłumienie zakłóceń na wysokich częstotliwościach w porównaniu do układów klasycznych.
-
Supply current spectrum estimation of digital cores at early design
PublicationPrzedstawiono nową aproksymacyjną metodę obliczania widma prądu zasilania układów cyfrowych. Metoda oparta jest na charakterystyce impulsów prądowych w kategoriach ich czasu narastania, opadania i długości impulsu. Górną granicę widma (obwiednię) można obliczyć posługując się gęstością prawdopodobieństwa zmian stanu sygnałów w węzłach układu cyfrowego. W odróżnieniu od znanych metod, metoda proponowana wykorzystuje ograniczoną...
-
Właściwości sterowników przetwornic dc-dc opartych na algorytmach splotowych
PublicationW pracy przedstawiono wybrane problemy projektowania cyfrowych sterowników przetwornic impulsowych. Szczególny nacisk położono na syntezę umożliwiającą implementację sprzętową kontrolerów w oparciu o tanie technologie CMOS charakteryzujące się znacznymi ograniczeniami na szybkość działania bloków funkcjonalnych. Zaprezentowano symulacje porównawcze właściwości klasycznych korektorów cyfrowych uzyskanych na podstawie prototypu analogowego...
Year 2008
-
Optimization of active circuits for substrate noise suppression
PublicationZakłócenia generowane przez szybkie podukłady cyfrowe w mieszanych systemach analogowo-cyfrowych realizowanych na wspólnym podłożu stają się dużym problemem. W pracy zaproponowano metodę optymalizacji aktywnych układów tłumienia zakłóceń. Zilustrowano skuteczność działania metody na wybranym układzie i uzyskano ponad 9 dB poprawę tłumienia zakłóceń na częstotliwości 1GHz w porównaniu do znanych rozwiązań.
Year 2009
-
Analog multiplier for a low-power integrated image sensor
PublicationArtykuł przedstawia nowe podejście do projektowania tanich niskomocowych zintegrowanych sensorów optycznych. W odróżnieniu od wcześniej stosowanych rozwiązań opartych na masowym przetwarzaniu równoległym, zaproponowany mnożnik macierzowy charakteryzuje się korzystniejszymi cechami. Proponowane rozwiązanie, chociaż mniej elastyczne w sensie liczby możliwych do zaimplementowania algorytmów wstępnej obróbki obrazu, cechuje się znaczącą...
-
Analog multiplier for a low-power integrated image sensor
PublicationArtykuł przedstawia nowe podejście do projektowania tanich niskomocowych zintegrowanych sensorów optycznych. W odróżnieniu od wcześniej stosowanych rozwiązań opartych na masowym przetwarzaniu równoległym, zaproponowany mnożnik macierzowy charakteryzuje się korzystniejszymi cechami. Proponowane rozwiązanie, chociaż mniej elastyczne w sensie liczby możliwych do zaimplementowania algorytmów wstępnej obróbki obrazu, cechuje się znaczącą...
Year 2010
-
Frequency compensation for two-stage operational amplifiers with improved PSRR characteristic
PublicationW pracy została opisana nowa metoda kompensacji częstotliwościowej dwustopniowych wzmacniaczy operacyjnych. Metoda kompensacji gwarantuje uzyskanie stabilnej pracy wzmacniacza operacyjnego przy założeniu że wzmocnienie układu z zamkniętą pętlą sprzężenia zwrotnego jest ograniczone do wartości kilkunastu decybeli. W porównaniu do innych znanych metod kompensacji, zaproponowana metoda umożliwia co najmniej dziesięciokrotne poszerzenie...
Year 2011
-
Analog CMOS processor for early vision processing with highly reduced power consumption
PublicationA new approach to an analog ultra-low power visionchip design is presented. The prototype chip performs low-levelconvolutional image processing algorithms in real time. Thecircuit is implemented in 0.35 μm CMOS technology, contains64 x 64 SIMD matrix with embedded analogue processors APE(Analogue Processing Element). The photo-sensitive-matrix is of2.2 μm x 2.2 μm size, giving the density of 877 processors permm2. The matrix dissipates...
-
CMOS Low-Dropout Regulator With Improved Time Response
PublicationPrzedstawiono nową konfigurację regulatora o obniżonym spadku napięcia, w którym wykorzystano stopień wyjściowy z równoległym sprzężeniem napięciowym. Dzięki obniżonej rezystancji wyjściowej stopnia, uzyskano poprawę odpowiedzi impulsowej regulatora na szybką zmianę prądu wyjściowego.
-
CMOS realisation of analogue processor for early vision processing
PublicationThe architecture concept of a high-speed low-power analogue vision chip, which performs low-level real-time image algorithms ispresented. The proof-of-concept prototype vision chip containing 32 × 32 photosensor array and 32 analogue processors is fabricated usinga 0.35 μm CMOS technology. The prototype can be configured to register and process images with very high speed, reaching 2000 framesper second, or achieve very low power...
-
Mikromocowy procesor analogowy CMOS do wstępnego przetwarzania obrazu
PublicationW artykule przedstawiono scalony analogowy układ wizyjny (ang. vision chip), który wykonuje splotowe niskopoziomowe algorytmy przetwarzania obrazów w czasie rzeczywistym. Układ prototypowy został wykonany w technologii CMOS 0,35 μm i zawiera matrycę SIMD procesorów analogowych o rozmiarze 64 x 64. Wymiary topografii matrycy wynoszą 2,2 mm x 2,2 mm, co daje gęstość 877 procesorów na mm2. Matryca pobiera moc mniejszą niż 0,4 μW (poniżej...
-
Mikromocowy procesor analogowy CMOS do wstępnego przetwarzania obrazu
PublicationW artykule przedstawiono projekt i wyniki badań scalonego analogowego układu wizyjnego, który wykonuje splotowe niskopoziomowe algorytmy przetwarzania obrazu w czasie rzeczywistym. Układ prototypowy został wykonany w technologii CMOS 0,35 μm i zawiera matrycę SIMD procesorów analogowych o rozmiarze 64 x 64. Wymiary topografii matrycy wynoszą 2,2 mm x 2,2 mm, co daje gęstość 877 procesorów na mm2. Matryca pobiera moc mniejszą niż...
-
Output-capacitorless low-dropout regulator using a cascoded flipped voltage follower
PublicationPrzedstawiono udoskonaloną konfigurację wtórnika napięciowego w odwróconej konfiguracji oraz jej zastosowanie w regulatorze o małym spadku napięcia. W pracy przedstawiono teoretyczną analizę podstawowych parametrów wtórnika oraz regulatora napięcia. Ponadto przedstawiono wyniki pomiarów parametrów prototypowego układu scalonego wykonanego z użyciem technologii CMOS 0.35 um. Uzyskane wyniki porównano z rezultatami uzyskanymi w innych...
Year 2012
-
Characteristics of an image sensor with early-vision processing fabricated in standard 0.35 µm CMOS technology
PublicationThe article presents measurement results of prototype integrated circuits for acquisition and processing of images in real time. In order to verify a new concept of circuit solutions of analogue image processors, experimental integrated circuits were fabricated. The integrated circuits, designed in a standard 0.35 µm CMOS technology, contain the image sensor and analogue processors that perform low-level convolution-based image...
seen 1208 times