Wyszukiwarka
Abstrakt
A new approach to an analog ultra-low power medium-resolution vision chip design is presented. The prototype chip performs low-level image processing algorithms in real time. Only a photo-diode, MOS switches and two capacitors are used to create an analog processing element (APE) that is able to realize any convolution algorithm based on a full 3x3 kernel. The proof-of-concept circuit is implemented in 0.35 µm CMOS technology, and contains a 64x64 SIMD matrix with embedded APEs. The matrix dissipates less than 0.3 mW (less than 0.1 µW per APE) of power under 3.3 V supply, and its image processing speed is up to 100 frames/s.
Cytowania
-
3 0
CrossRef
-
0
Web of Science
-
3 7
Scopus
Autorzy (5)
Cytuj jako
Pełna treść
pełna treść publikacji nie jest dostępna w portalu
Słowa kluczowe
Informacje szczegółowe
- Kategoria:
- Publikacja w czasopiśmie
- Typ:
- artykuł w czasopiśmie wyróżnionym w JCR
- Opublikowano w:
-
IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS I-REGULAR PAPERS
nr 60,
wydanie 2,
strony 279 - 289,
ISSN: 1549-8328 - Język:
- angielski
- Rok wydania:
- 2013
- Opis bibliograficzny:
- Jendernalik W., Blakiewicz G., Jakusz J., Szczepański S., Piotrowski R.: An Analog Sub-Miliwatt CMOS Image Sensor With Pixel-Level Convolution Processing// IEEE TRANSACTIONS ON CIRCUITS AND SYSTEMS I-REGULAR PAPERS. -Vol. 60, iss. 2 (2013), s.279-289
- DOI:
- Cyfrowy identyfikator dokumentu elektronicznego (otwiera się w nowej karcie) 10.1109/tcsi.2012.2215803
- Weryfikacja:
- Politechnika Gdańska
wyświetlono 211 razy
Publikacje, które mogą cię zainteresować
Analogue CMOS ASICs in Image Processing Systems
- W. Jendernalik,
- G. Blakiewicz,
- A. Handkiewicz
- + 1 autorów
2013